IT之家 10 月 22 日音尘，华硕中国区总司理俞元麟（@普粗鄙通 Tony 大叔）今天（10 月 22 日）在 B 站发布视频，贯通了英特尔 Arrow Lake 酷睿 Ultra 200 系列处理器的架构hongkongdoll xxx，并共享了酷睿 Ultra 285K 高清 Die Shots 图片。
哥也色蝴蝶谷视频最初开箱了英特尔酷睿 Ultra 5 245K、Ultra 7 265K 和 Ultra 9 285K 处理器，遴荐了深玄色包装诡计。
接下来咱们长远先容下英特尔酷睿 Ultra 9 285K 的 die shots 图片，不错看到共有以下 6 种 Tiles：
Compute Tile：遴荐台积电 N3B 工艺
Graphics Tile：遴荐台积电 N5P 工艺
SoC Tile：遴荐台积电 N6 工艺
I/O Tile：遴荐台积电 N6 工艺
2 个 Filer Tile：N / A
Base Tile：Intel 1227.1
除了 5 个操作 Tiles 除外，酷睿 Ultra 200 系列“Arrow Lake”处理器还有 2 个 Filer Tile，旨在保执结构好意思满性。
英特尔暗示这些 Filer Tile 为散热器提供一个均匀、无空腔的名义，淌若莫得这个，可能会导致 IHS 周折致使被压碎，从而酿成芯片损坏和不消要的故障。
Compute TileCPU 的主要部分是 Compute Tile，最多不错容纳 8 个 Lion Cove P 中枢和 16 个 Skymont E 中枢。
上一代 Raptor Lake 和 Alder Lake 系列的 P 中枢和 E 中枢位于 Compute Tile 的两个孤苦区域，而 Arrow Lake CPU 将 P 中枢和 E 中枢联结在一王人，从而末端了众多的环形总线互聚合构和更好的热惩办。
IT之家附上英特尔 Compute Tile 主要特征如下
基于台积电 N3B 工艺（Raptor Lake 为 Intel 10nm++）
最多 8 个 P 核（Lion Cove）
最多 16 个 E 核（Skymont）
环形总线互连
谈判单位基于 TSMC N3B 工艺节点，这亦然英特尔桌面系列初次遴荐外部工艺节点，而之前的几代居品则是基于 Intel 自家的工艺制造的。
英特尔 Arrow Lake SoC Tile 的主要特征如下：
基于台积电 N6 工艺
DDR5 内存阻抑器（5600 MT/s 原生速率）
维持 UDIMM / CUDIMM / CAMMII
最高 13 TOPS NPU3
Media Engine (H.264/H.265/AV1)
PCIe 5.0 x16 用于孤苦显卡
英特尔 Arrow Lake I/O Tile 的主要特征如下：
基于台积电 N6 工艺
1 个 PCIe 5.0 x4 （SSD）
1 个 PCIe 4.0 x4（固态硬盘）
Graphics Tile该 Tile 配备 4 个 Xe-LPG “Alchemist”中枢。
英特尔的 Arrow Lake CPU 并不是 100% 的芯粒（chiplet）诡计。天然每个 Tile 都是一个孤苦的实体，使用不同的工艺时间而且功能也不同，但它们都基于换取的基础模块，并以看似单一芯片的方法打包在一王人。
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